Compte tenu des exigences de protection contre les surtensions du port réseau client (telles que la norme CEI 61000-4-5), la combinaison de dispositifs de protection à plusieurs niveaux suivante est recommandée pour garantir que le test de surtension est réussi et que le circuit back-end est protégé.
01 Dispositifs de protection de base et leurs fonctions

02 Conception de circuit typique (en prenant le port réseau RJ45 comme exemple)

Protection niveau 1 (GDT) :
Connectez un GDT en parallèle entre chaque paire de lignes différentielles (telles que TX+/TX-) et la terre pour absorber la foudre ou l'énergie EFT. Exigences de sélection : tension de claquage CC ≥90 V, capacité de charge actuelle ≥5 kA (8/20 μs).
Protection secondaire (TVS) :
Utilisez un réseau TVS intégré (tel que RClamp0524P) pour protéger quatre paires de lignes différentielles, avec une tension de serrage de ≤ 15 V et un temps de réponse de < 1 ns pour garantir que la tension résiduelle n'endommage pas la puce PHY.
Filtrage en mode commun (CMC) :
Supprime le bruit de mode commun causé par les surtensions et améliore l'intégrité du signal.
Protection de l'alimentation PoE (PTC) :
Si l'alimentation PoE est prise en charge, connectez un PTC en série dans le chemin d'alimentation pour limiter les surintensités.
Considérations clés en matière de conception
01 Optimisation de la disposition des PCB
Le GDT/TVS doit être aussi proche que possible du port réseau, avec un câblage court et droit pour réduire l'inductance parasite ; le plan de masse doit être complet et une mise à la terre multipoint doit être utilisée pour réduire l'impédance.
02 Correspondance des normes de test
Décharge de contact : ±8 kV (IEC 61000-4-2) nécessite une combinaison TVS+CMC ;
Test de surtension : ±4 kV (IEC 61000-4-5) nécessite une protection GDT+TVS à deux niveaux.
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3 Vérification de la sélection des appareils
Vérifiez les caractéristiques de serrage du TVS grâce aux tests TLP ; surveillez la tension sur la broche de la puce PHY pendant la surtension réelle pour vous assurer qu'elle est inférieure à la tension de tenue (par exemple, une puce PHY de 3,3 V nécessite une tension résiduelle de <6 V).
03 Indicateurs de performance des solutions recommandées

04 Coûts et alternatives
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