WHLC-3216A-600M0 100/1000BASE-T Cap+CMC Size3216（1206）L(μH)60 non-PoE Chip LAN

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Das kapazitive CHIP LAN (ein kondensatorbasierter Chip-LAN-Transformator) verwendet hochpräzise Kopplungskondensatoren anstelle herkömmlicher Magnetkernspulen, um Signalisolierung und Impedanzanpassung zu erreichen.

1. Hauptvorteile: extrem kleine Größe (bis zu 1,6 x 0,8 mm), Unterstützung für ultrahohe Raten (10 Gbit/s+), geringere Kosten und kein Bedarf an magnetischen Materialien.

2. Einschränkungen: Es werden nur AC-Signale übertragen, daher ist die symmetrische DC-Kodierung eingeschränkt. schlechter Tieffrequenzgang (typischerweise >100 kHz); Gleichtaktunterdrückung und Überspannungsschutz sind schwächer als bei herkömmlichen Transformatoren; und es ist empfindlich gegenüber ESD.

3. Anwendbare Szenarien: Unterhaltungselektronik mit extrem begrenztem Platzangebot (z. B. ultradünne Laptops, Telefon-Dockingstationen), Hochgeschwindigkeitsverbindungen mit kurzer Reichweite (Server-Backplanes, optische Module) und kostenempfindliche IoT-Geräte. Es eignet sich nicht für Industriestandorte, PoE-Stromversorgung oder den Einsatz im Freien über große Entfernungen, die eine starke Isolierung und Störfestigkeit erfordern.

Kapazitives CHIP-LAN nutzt kapazitive Kopplung, um eine Ethernet-Isolation zu erreichen. Im Vergleich zum magnetischen Kopplungsansatz herkömmlicher magnetischer Transformatoren bestehen die wesentlichen Unterschiede darin, dass ersterer Wechselstromsignale über Hochspannungskondensatoren überträgt und dadurch eine höhere Integration (erreichbar auf einem einzigen Chip), eine geringere Gehäusehöhe, bessere Hochfrequenzeigenschaften und Immunität gegen Magnetfeldstörungen bietet – er kann jedoch keinen Gleichstrom übertragen (und unterstützt daher kein PoE). Letzteres beruht auf einer induktiven magnetischen Kernkopplung; Es ist größer und neigt bei Magnetfeldern zur Sättigung, kann aber gleichzeitig Gleichstrom isolieren und ist natürlich mit PoE kompatibel.

(1) Platzieren Sie DC-Blockkondensatoren (typischerweise 0,1 μF) in Reihe am Eingang und Ausgang, um zu verhindern, dass die DC-Vorspannung die Kopplungsgenauigkeit beeinträchtigt. (2) Signalspuren müssen unbedingt eine Differenzimpedanz von 100 Ω einhalten, so kurz wie möglich gehalten werden und sich auf eine vollständige Masseebene beziehen. (3) Fügen Sie eine Gleichtaktdrossel auf der PHY-zugewandten Seite des CHIP-LANs hinzu, um dessen unzureichendes CMRR auszugleichen. (4) Fügen Sie ESD-Schutzdioden hinzu (z. B. die TLP-Serie), da CHIP LAN selbst eine schwache ESD-Immunität aufweist. (5) Vermeiden Sie den Einsatz dort, wo Isolationsspannungen über 500 V erforderlich sind, da sonst die Gefahr eines Ausfalls besteht.

Kapazitiv CHIP LAN hat ein relativ schwaches Gleichtaktunterdrückungsverhältnis (CMRR) und eine schlechte Immunität gegen Gleichtaktstörungen. Das Hinzufügen einer Gleichtaktdrossel kompensiert diese EMV-Schwäche, unterdrückt Gleichtaktrauschen und verbessert die Immunität gegen ESD und abgestrahlte Störungen.